74AUP2G157GS: 低功耗2输入多路复用器
74AUP2G157是单路2输入多路复用器，其在公共数据选择输入(S)的控制下从两个数据输入（I0和I1）选择数据。一般数据选择输入的状态可确定数据来自哪个特定的寄存器。输出（Y，Y）以真正（非反相）和补充形式呈现所选数据。使能输入(E)为低电平有效。E为高电平时，无论所有其他输入条件如何，输出Y被强制为低电平且输出Y被强制为高电平。
所有输入处的施密特触发器动作使电路容许整个0.8 V至3.6 V VCC范围内较慢的输入上升和下降时间。该器件可确保整个0.8 V至3.6 V CC范围内极低的静态和动态功耗。
该器件完全适合使用IOFF的局部掉电应用。IOFF电路可禁用输出，防止掉电时破坏性回流电流通过该器件。
74AUP2G157GS: 产品结构框图
sot1203_3d
数据手册 (1)
| 名称/描述 | Modified Date |
|---|---|
| Low-power 2-input multiplexer (REV 7.0) PDF (294.0 kB) 74AUP2G157 [English] | 18 Jan 2013 |
应用说明 (2)
| 名称/描述 | Modified Date |
|---|---|
| Sorting through the low voltage logic maze (REV 1.0) PDF (72.0 kB) AN10156 [English] | 13 Mar 2013 |
| Pin FMEA for AUP family (REV 1.0) PDF (53.0 kB) AN11052 [English] | 06 May 2011 |
手册 (3)
| 名称/描述 | Modified Date |
|---|---|
| 電圧レベルシフタ (REV 1.1) PDF (3.1 MB) 75017511_JP [English] | 16 Feb 2015 |
| NXP® ultra-low-power CMOS logic 74AUP1G/2G/3Gxxx: Advanced, ultra-low-power CMOS logic (REV 1.0) PDF (1.4 MB) 75017458 [English] | 13 Oct 2014 |
| Voltage translation: How to manage mixed-voltage designs with NXP® level translators (REV 1.0) PDF (2.6 MB) 75017511 [English] | 20 May 2014 |
选型工具指南 (2)
| 名称/描述 | Modified Date |
|---|---|
| ロジック製品セレクションガイド... (REV 1.0) PDF (38.3 MB) LOGIC_SELECTION_GUIDE_2015_JP [English] | 19 Nov 2015 |
| Logic selection guide 2016 (REV 1.1) PDF (15.3 MB) 75017285 [English] | 08 Jan 2015 |
封装信息 (1)
| 名称/描述 | Modified Date |
|---|---|
| extremely thin small outline package; no leads; 8 terminals (REV 1.0) PDF (188.0 kB) SOT1203 [English] | 08 Feb 2016 |
包装 (1)
| 名称/描述 | Modified Date |
|---|---|
| Standard product orientation 12NC ending 115 (REV 1.0) PDF (88.0 kB) SOT1203_115 [English] | 03 Jul 2013 |
支持信息 (1)
| 名称/描述 | Modified Date |
|---|---|
| MAR_SOT1203 Topmark (REV 1.0) PDF (73.0 kB) MAR_SOT1203 [English] | 03 Jun 2013 |
IBIS
- aup2g157 IBIS model (REV 1.1) ibs AUP2G157 4/8/2013
订购信息
| 型号 | 状态 | Family | 功能 | VCC (V) | Logic switching levels | 说明 | Output drive capability (mA) | Package version | tpd (ns) | Power dissipation considerations | Tamb (Cel) | Rth(j-a) (K/W) | Ψth(j-top) (K/W) | Rth(j-c) (K/W) | Package name | No of pins |
|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|
| 74AUP2G157GS | Active | AUP | Digital multiplexers | 1.1 - 3.6 | CMOS | single 2-input multiplexer | 1.9/-1.9 | SOT1203 | 3.4 | ultra low | -40~125 | 276 | 10.8 | 146 | XSON8 | 8 |
封装环保信息
| 产品编号 | 封装说明 | Outline Version | 回流/波峰焊接 | 包装 | 产品状态 | 部件编号订购码 (12NC) | Marking | 化学成分 | RoHS / 无铅 / RHF | 无铅转换日期 | MSL | MSL LF |
|---|---|---|---|---|---|---|---|---|---|---|---|---|
| 74AUP2G157GS | | SOT1203 | Reel 7" Q1/T1 | Active | 74AUP2G157GS,115 (9352 927 83115) | aP | 74AUP2G157GS |    | Always Pb-free | 1 | 1 |
- Low-power 2-input multiplexer 74AUP2G157GT
- Sorting through the low voltage logic maze 74LVC_H_245A_Q100
- Pin FMEA for AUP family 74AUP1T34GW-Q100
- 電圧レベルシフタ 74AVC16245DGG-Q100
- NXP® ultra-low-power CMOS logic 74AUP1G/2G/3Gxxx: Advanced, ultra-low-power CMOS logic 74AUP1G86GW-Q100
- Voltage translation: How to manage mixed-voltage designs with NXP® level translators 74AVC16245DGG-Q100
- ロジック製品セレクションガイド... 74LVC_H_245A_Q100
- Logic selection guide 2016 74LVC_H_245A_Q100
- MAR_SOT1203 Topmark 74AXP2T3407GS
- aup2g157 IBIS model 74AUP2G157GT
- SOT1203 74AXP2T3407GS
- Reel 7" Q1/T1 74AXP2T3407GS
- 74AVCM162836DGG
- 74LVC3G17
