74HC73是符合JEDEC标准no. 7A的高速硅栅CMOS器件。它与低功耗肖特基TTL(LSTTL)引脚兼容。
774HC73是双路负沿触发JK型触发器,具有单独的JK时钟(nCP)和复位(nR)输入;以及补充nQ和nQ输出。
在时钟从高到低转换前的某个建立时间,J输入和K输入必须保持稳定,以进行可预测操作。
复位(nR)是异步有源低电平输入。低电平时,它会覆盖时钟和数据输入,将nQ输出强制为低电平和高电平。
时钟输入的施密特触发器动作使电路高度容许较缓慢的时钟上升时间和下降时间。
名称/描述 | Modified Date |
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Dual JK flip-flop with reset; negative-edge trigger (REV 5.0) PDF (174.0 kB) 74HC73 [English] | 02 Dec 2015 |
名称/描述 | Modified Date |
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Live Insertion Aspects of Philips Logic Families (REV 1.0) PDF (73.0 kB) AN252 [English] | 13 Mar 2013 |
Pin FMEA 74HC/74HCT family (REV 1.0) PDF (51.0 kB) AN11044 [English] | 16 Mar 2011 |
名称/描述 | Modified Date |
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HC/T User Guide (REV 1.0) PDF (508.0 kB) HCT_USER_GUIDE [English] | 01 Nov 1997 |
名称/描述 | Modified Date |
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plastic small outline package; 14 leads; body width 3.9 mm (REV 1.0) PDF (166.0 kB) SOT108-1 [English] | 08 Feb 2016 |
名称/描述 | Modified Date |
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Footprint for reflow soldering (REV 1.0) PDF (9.0 kB) SO-SOJ-REFLOW [English] | 08 Oct 2009 |
Footprint for wave soldering (REV 1.0) PDF (8.0 kB) SO-SOJ-WAVE [English] | 08 Oct 2009 |
型号 | 状态 | Family | VCC (V) | 功能 | 说明 | Logic switching levels | Output drive capability (mA) | Package version | tpd (ns) | fmax (MHz) | Power dissipation considerations | Tamb (Cel) | Rth(j-a) (K/W) | Ψth(j-top) (K/W) | Rth(j-c) (K/W) | Package name | No of pins |
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74HC73D | Active | HC(T) | 2.0 - 6.0 | J-K type flip-flops | negative-edge trigger | CMOS | +/- 5.2 | SOT108-1 | 16 | 77 | low | -40~125 | 74 | 1.0 | 31 | SO14 | 14 |
产品编号 | 封装说明 | Outline Version | 回流/波峰焊接 | 包装 | 产品状态 | 部件编号订购码 (12NC) | Marking | 化学成分 | RoHS / 无铅 / RHF | 无铅转换日期 | EFR | IFR(FIT) | MTBF(小时) | MSL | MSL LF |
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74HC73D | SOT108-1 | SO-SOJ-REFLOW
SO-SOJ-WAVE SO-SOJ-REFLOW SO-SOJ-WAVE | Reel 13" Q1/T1 CECC | Active | 74HC73D,653 (9337 144 30653) | 74HC73D | 74HC73D | week 30, 2004 | 84.9 | 6.62 | 1.51E8 | 1 | 1 | ||
Bulk Pack, CECC | Active | 74HC73D,652 (9337 144 30652) | 74HC73D | 74HC73D | week 30, 2004 | 84.9 | 6.62 | 1.51E8 | 1 | 1 |