74ALVT16821高性能双极补充金属氧化半导体(BiCMOS)器件结合了低静态和动态功耗以及高速和高输出驱动能力。它设计用于I/O 兼容性高达5 V、在2.5 V或3.3 V电压下进行VCC操作。
74ALVT16821具有两个10位边沿触发寄存器,每个寄存器都耦合到一个三态输出缓冲器。每个寄存器的两个部分由时钟(nCP)和输出使能(nOE)控制逻辑门独立控制。
每个寄存器为完全边沿触发。在时钟从低到高转换前的某个建立时间,每个D输入的状态会被传输到相应的触发器Q输出。
三态输出缓冲器设计用于驱动重负载三态总线、MOS存储器或MOS微处理器。
有源低电平输出使能(nOE)可控制所有十个不受寄存器操作影响的三态缓冲器。nOE为低电平时,寄存器内的数据会出现在输出处。nOE为高电平时,输出处于高阻抗“关断”状态,这表示这些输出既不能驱动也不能加载总线。
名称/描述 | Modified Date |
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20-bit bus interface D-type flip-flop; positive-edge trigger; 3-state (REV 3.0) PDF (106.0 kB) 74ALVT16821 [English] | 13 Jun 2005 |
名称/描述 | Modified Date |
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Sorting through the low voltage logic maze (REV 1.0) PDF (72.0 kB) AN10156 [English] | 13 Mar 2013 |
Package lead inductance considerations in high-speed applications (REV 1.0) PDF (43.0 kB) AN212 [English] | 13 Mar 2013 |
Ground and VCC Bounce of High-Speed Integrated Circuits (REV 1.0) PDF (25.0 kB) AN223 [English] | 13 Mar 2013 |
Live Insertion Aspects of Philips Logic Families (REV 1.0) PDF (73.0 kB) AN252 [English] | 13 Mar 2013 |
Test Fixtures for High Speed Logic (REV 1.0) PDF (341.0 kB) AN203 [English] | 02 Apr 1998 |
Transmission Lines and Terminations with Philips Advanced Logic Families (REV 1.0) PDF (217.0 kB) AN246 [English] | 01 Feb 1998 |
LVT (Low Voltage Technology) and ALVT (Advanced LVT) (REV 1.0) PDF (133.0 kB) AN243 [English] | 01 Jan 1998 |
Interfacing 3 Volt and 5 Volt Applications (REV 1.0) PDF (63.0 kB) AN240 [English] | 15 Sep 1995 |
名称/描述 | Modified Date |
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電圧レベルシフタ (REV 1.1) PDF (3.1 MB) 75017511_JP [English] | 16 Feb 2015 |
Voltage translation: How to manage mixed-voltage designs with NXP® level translators (REV 1.0) PDF (2.6 MB) 75017511 [English] | 20 May 2014 |
名称/描述 | Modified Date |
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ロジック製品セレクションガイド... (REV 1.0) PDF (38.3 MB) LOGIC_SELECTION_GUIDE_2015_JP [English] | 19 Nov 2015 |
Logic selection guide 2016 (REV 1.1) PDF (15.3 MB) 75017285 [English] | 08 Jan 2015 |
名称/描述 | Modified Date |
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plastic thin shrink small outline package; 56 leads; body width 6.1 mm (REV 1.0) PDF (506.0 kB) SOT364-1 [English] | 08 Feb 2016 |
名称/描述 | Modified Date |
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TSSOP56; Reel pack; SMD, 13" Q1/T1 Standard product orientation Orderable part number ending ,118 or... (REV 4.0) PDF (248.0 kB) SOT364-1_118 [English] | 15 Apr 2013 |
名称/描述 | Modified Date |
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Footprint for wave soldering (REV 1.0) PDF (16.0 kB) SSOP-TSSOP-VSO-WAVE [English] | 08 Oct 2009 |
型号 | 状态 | Family | 功能 | VCC (V) | Logic switching levels | 说明 | Output drive capability (mA) | Package version | tpd (ns) | fmax (MHz) | Power dissipation considerations | Tamb (Cel) | Rth(j-a) (K/W) | Ψth(j-top) (K/W) | Rth(j-c) (K/W) | Package name | No of pins |
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74ALVT16821DGG | Active | ALVT | D-type flip-flops | 2.3 - 3.6 | TTL | positive-edge trigger (3-state) | -32/+64 | SOT364-1 | 1.8 | 150 | medium | -40~85 | 93 | 21.0 | TSSOP56 | 56 |
产品编号 | 封装说明 | Outline Version | 回流/波峰焊接 | 包装 | 产品状态 | 部件编号订购码 (12NC) | Marking | 化学成分 | RoHS / 无铅 / RHF | 无铅转换日期 | EFR | IFR(FIT) | MTBF(小时) | MSL | MSL LF |
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74ALVT16821DGG | SOT364-1 | SSOP-TSSOP-VSO-WAVE | Tube in Drypack | Active | 74ALVT16821DGGS (9352 100 10512) | ALVT16821 | 74ALVT16821DGG | Always Pb-free | 70.8 | 1.33 | 7.52E8 | 2 | 2 | ||
Reel 13" Q1/T1 in Drypack | Active | 74ALVT16821DGGY (9352 100 10518) | ALVT16821 | 74ALVT16821DGG | Always Pb-free | 70.8 | 1.33 | 7.52E8 | 2 | 2 |